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ac6 >> ac6-formation >> Communications >> Connectivity >> FireWire Télécharger la page Ecrivez nous

IP1 FireWire

This course covers IEEE1394, IEEE1394a, IEEE1394b and DV specification

formateur
Objectives
  • Differential transmission advantages are highlighted.
  • The course explains the bus initialization process.
  • Packet format and subaction transactions are described with the assistance of the Lecroy FireInspector
  • 1394a arbitration enhancements are emphasized.
  • The course describes the new 1394b beta signalling.
  • After having introduced digital camera fundamentals, isochronous traffic is analysed.
  • The OHCI specification and especially the management of transfer descriptors is also handled in this course.
A Lecroy FireWire analyser is used to capture and display USB traffic.
•  A lot of traces are included in the material.
A more detailed course description is available on request at formation@ac6-formation.com
  • Experience of a digital bus is mandatory.
  • Cours théorique
    • Support de cours au format PDF (en anglais) et une version imprimée lors des sessions en présentiel
    • Cours dispensé via le système de visioconférence Teams (si à distance)
    • Le formateur répond aux questions des stagiaires en direct pendant la formation et fournit une assistance technique et pédagogique
  • Au début de chaque demi-journée une période est réservée à une interaction avec les stagiaires pour s'assurer que le cours répond à leurs attentes et l'adapter si nécessaire
  • Tout ingénieur ou technicien en systèmes embarqués possédant les prérequis ci-dessus.
  • Les prérequis indiqués ci-dessus sont évalués avant la formation par l'encadrement technique du stagiaire dans son entreprise, ou par le stagiaire lui-même dans le cas exceptionnel d'un stagiaire individuel.
  • Les progrès des stagiaires sont évalués par des quizz proposés en fin des sections pour vérifier que les stagiaires ont assimilé les points présentés
  • En fin de formation, une attestation et un certificat attestant que le stagiaire a suivi le cours avec succès.
    • En cas de problème dû à un manque de prérequis de la part du stagiaire, constaté lors de la formation, une formation différente ou complémentaire lui est proposée, en général pour conforter ses prérequis, en accord avec son responsable en entreprise le cas échéant.

Plan du cours

  • Bus creation and history
  • 1394 bus architecture
  • Technical introduction : time-slicing
  • Support of asynchronous and isochronous transactions
  • Protocols stack : AVC, SBP-2, 1883, HAVI, IP
  • Unified transactions
  • The transaction layer
  • The link layer
  • The physical layer
  • The management layer
  • Protocol implementation, highlighting the separation between software and hardware domains
  • LVDS technology basics
  • Data and strobe encoding
  • Line states for arbitration, configuration and reset
  • Decoding rules
  • Idle bus delays to enable arbitration requests : the gaps
  • Power Classes
  • Suspend / Resume mechanism
  • IEEE1212 address definition and node mapping
  • Link layer Control & Status Registers
  • Link layer configuration ROM organization
  • PHY layer registers
  • TI 12LV22 programming interface to access local PHY registers
  • Reset causes
  • Initialization steps
  • Tree building, contention resolution
  • Self-ID process, Self-ID packet format
  • Software configuration : cycle master enabling, IRM identification, Bus Manager select
  • Geographic priority
  • Arbitration for asynchronous transfers
  • Arbitration for synchronous transfers
  • Inefficiency of gaps when data rate increases
  • 1394a optimizations : accelerated and fly-by arbitrations
  • Read and Write REQ/RESP packet format
  • Resource locking
  • Retry goals
  • Single-phase retry
  • Transaction errors management
  • Digital camera control command registers
  • Camera initialize register
  • Isochronous packet format for VGA non compressed format (Format_0)
  • Video data payload structure
  • Talker and listeners
  • Channel number and bandwidth allocation
  • Real time data flows requirements
  • Packet format
  • Pinout
  • PHY register access
  • Status information transmission from PHY to Link
  • Packet transmission timing diagram
  • Packet receipt timing diagram
  • New transmission media
  • Bilingual ports
  • Compatibility with 1394/1394a specifications
  • Optic transmission fundamentals
  • Full duplex communication
  • Scrambler / Descrambler operation
  • Benefits of 8b/10b encoding
  • Training sequence
  • Symbol use instead of gaps
  • Bus requests pipelining, arbitration phases
  • Arbitration in a hybrid tree including DS ports and Beta ports
  • Tones usage
  • Auto-negotiation
  • Standby / Restore mechanism
  • Loop removing
  • Enhancement of the 1394a PHY-LINK interface to support S800
  • New PIL-FOP interface to support higher data rates
  • Point-to-point packet protocol between the PIL and the FOP
  • SelfID receive
  • Asynchronous transmit DMA
  • Asynchronous receive DMA
  • Isochronous transmit DMA
  • Isochronous receive DMA
  • Physical requests
  • Error management